Demi sec
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The spd's are programmed to jedec standard latency ddr timing of 9-9-9 at 15v (v ~ v) • 667mhz fck for mb/sec/pin • 8 independent internal bank • programmable cas latency: • programmable additive latency: 0, cl - 2, or cl - 1 clock • programmable cas write latency(cwl) = 7 (ddr-bit pre-fetch • burst length: 8 (interleave without any limit, sequential with starting address “000” only), 4 with tccd = 4 which does not allow seamless read or write [either on the fly using a12 or mrs] • bi-directional differential data strobe • thermal sensor grade b • internal(self) calibration: internal self calibration through zq pin (rzq: 240 ohm ± 1%) • on die termination using odt pin • average refresh period 75v (v ~v) power supply • vddq = 1memoria kingston 8gb ddrmhz, 8gbyte, 2rx8 1gx72-bit, pc modelo: kvrd3e9s/8g description valueram's 1g x 72-bit (8gb) ddr cl9 sdram (synchronous dram), 2rx8, ecc memory modules, based on eighteen 512m x 8-bit fbga components per module9us at 85°c • asynchronous reset • pcb: height mm), double sided component::::::::: digital general service::::::::::::: somos mercadolíder todo tipo de requerimiento informático san martín - gba envíos a todos el país correo argentino o transporte ===================================8us at lower than tcase 85°c, 3each 240-pin dimm uses gold contact fingersthe electrical and mechanical specifications are as follows: features • jedec standard 1
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